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一、 工作內容：全方位房產專家 【買賣仲介】 協助客戶買屋、賣屋，達成人生目標。 【租賃服務】 媒合房東與租客，創造安心租屋體驗。 【專業諮詢】 提供房產相關知識，解答客戶各類疑慮。 【售後服務】 成交後持續關懷，建立長久信任關係。 二、 薪資保障：首年領跑，收入有感 【新人起步最安心】 前6個月保障月領5萬，無壓力學習。 【挑戰月領7萬】 通過甄選或考核，成為菁英業務，挑戰首年月領7萬。 【轉職零風險】 業界首創「30天工作鑑賞期」，期滿不適任加發5萬轉職金。 【獎金無上限】 轉正後享底薪＋豐富獎金（個人、團體、年終、長期發展獎金）。 【證照加碼金】 入職前考取經紀人證照，任職半年加發3.6萬，每月最高加薪9千。 三、培育體系：180天打造菁英 【系統化課程】 上百堂全方位培訓，協助新人快速上手。 【一對一師徒制】專屬師父手把手帶領，新手變高手。 【大師班資源】 菁英業務由超業、店長、HR組成團隊，提供深度指導與適應關懷。 四、 競爭優勢：科技賦能與國際舞台 【AI 智能配案】利用大數據與 AI模型，協助業務精準媒合買賣需求，讓成交更快，更準! 【升遷不受限】 實力決定職位，最年輕24歲當店長、30歲升區協理。 【國際化視野】 集團跨足全球，包含日本、中國等海外據點，發展空間廣闊。

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加入我們，你將在充實的培訓與實務中，成為公司不可或缺的靈魂人物，助你在短期內邁向職場新高度！ 分店秘書｜信義房屋分店的核心助力 工作內容： 1. 分店運作的關鍵角色： 作為信義房屋分店的一員，您將是協助分店順暢運作的核心力量，從行政報表產出、客戶接待，到電話接聽、協助分店行銷和管理財務，全面支持業務團隊無後顧之憂地服務客戶。 2. 內外溝通的橋樑： 您將擔任分店與總部之間的溝通樞紐，透過與總部的緊密互動，培養並提升您的內部溝通及協調能力。 職務亮點： 1.快速上手，晉升透明： 在儲備培訓期間，透過一對一師徒制的專業指導，亦有機會跨店代理，接觸不同環境及同事，增進專業技能與職場經驗。 儲備秘書通常在1到3個月內可獨當一面，成為分店的重要助力，並在公平、明確的晉升機制下穩步發展。 2.分店秘書專屬福利： 我們提供豐富的團隊活動，包括分店定期聚餐、出遊，更有機會隨著分店績效達標參加海外旅遊，讓工作與生活更加精彩！ 3.彈性排休： 可根據個人需求彈性安排休假，但實際休假時間可能視分店人力情況進行調整。 4.多元職涯發展： 除了日常行政工作，您還有機會定期前往總公司參加各類豐富課程，學習攝影剪輯、文案撰寫等技能，全方位提升自己。 此外，還有機會到信義集團其他部門或單位進行輪調，拓展您的專業領域，助您打造更全面的職涯發展。 ✔邀請您了解更多秘書日常 https://reurl.cc/6vOYnd https://www.facebook.com/groups/1051429854925276?locale=zh_TW 【我們正在尋找這樣的你】 1. 具備快速學習能力，能夠協助分店日常業務與行政作業。 2. 擁有熱情的接待態度，並具備良好的溝通協調能力。 3. 熟練使用文書處理軟體 (PowerPoint、Word、Excel)。 4. 注重細節，確保分店財務報表及文件的正確性。 【應徵條件】 1. 大學畢業 2. 無房仲相關經驗 #快來加入我們，一起當散播幸福的信義人！ 【關於 Sinyi Realty信義企業集團】 信義房屋創業超過40年，堅持「企業永續發展」與「成就世界級服務業」的目標，並以全台直營模式經營，提供客戶高品質的服務。 創新推動多項業界首創制度，如「不動產說明書」、「漏水保固制度」、「成屋履約保證」，並啟動「社區一家」計畫及零碳環保專案，展現我們對永續發展的承諾。 我們秉持「以人為本」的宗旨，致力調和各利害關係人的需求，為社會與環境創造永續幸福。

工作項目： 負責下列工作項目之一 1. RF Transceiver設計。 2. LNA/Mixer/PA/VCO設計。 3. RF Frequency Synthesizer設計。 4. PGA/LPF設計。 5. RF EM Modeling。 應徵條件： 1. 碩士(含)以上; 電子電機、電控、電信、通訊等相關科系畢業。 2. 具射頻或類比電路工作經驗者。 3. 熟悉 Cadence EDA環境、Matlab。

工作項目： 1.熟悉CMOS 射頻或類比混合訊號電路設計, 如 PA/LNA/VCO/PLL/LPF…等電路 2.具備RF Transceiver架構及系統知識. 應徵條件： 1.碩士以上;電機工程、電信工程、電控工程、電子工程相關科系畢業為主 (MD17B0001)(MD17C0025)

工作項目： 1.High-Performance CPU & GPU & Armv9 & Server-class Compute SubSystem (CSS) Frontend Implementation (including STD cells/SRAM analysis & selection, DFT insertion, Synthesis, low power cells insertion & verification) 2.Advanced ASIC Implementation Flow Development & Automation: High-performance, Low Power, and PPA (Performance, Power, Area) Optimization 3.Physical Synthesis and Collaboration with P&R in Timing/Congestion Analysis and PPA Optimization 4.Perform Power Replay and Power Analysis 5.Perform Pre-layout/Post-layout Quality Checks (including LEC, CLP, ATPG, GCA, PPA quality) 應徵條件： 1.碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2.熟悉 Frontend EDA Tools、Synthesis、Timing Analysis、Low Power Implementation Flow & PPA (Performance, Power, Area) Optimization。 3.有開發Automation Flow的經驗，熟悉 TCL/Perl/Python。 4.英文能力良好，聽說讀寫精通。 5.有 CPU、GPU、Multi-Core Processor、Compute SubSystem Implementation 經驗尤佳，例如 Synthesis/Floorplan/CLP/DFT等。 6.積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU/CSS、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。

工作項目： 1.High-Performance CPU & GPU & Armv9 & Server-class Compute SubSystem (CSS) Frontend Implementation (including STD cells/SRAM analysis & selection, DFT insertion, Synthesis, low power cells insertion & verification) 2.Advanced ASIC Implementation Flow Development & Automation: High-performance, Low Power, and PPA (Performance, Power, Area) Optimization 3.Physical Synthesis and Collaboration with P&R in Timing/Congestion Analysis and PPA Optimization 4.Perform Power Replay and Power Analysis 5.Perform Pre-layout/Post-layout Quality Checks (including LEC, CLP, ATPG, GCA, PPA quality) 應徵條件： 1.碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2.熟悉 Frontend EDA Tools、Synthesis、Timing Analysis、Low Power Implementation Flow & PPA (Performance, Power, Area) Optimization。 3.有開發Automation Flow的經驗，熟悉 TCL/Perl/Python。 4.英文能力良好，聽說讀寫精通。 5.有 CPU、GPU、Multi-Core Processor、Compute SubSystem Implementation 經驗尤佳，例如 Synthesis/Floorplan/CLP/DFT等。 6.積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU/CSS、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。

●學歷要求： 研究所以上畢業。 ●科系要求： 電子、電機、資工、通訊、電信、自動控制相關科系，或相關工作3年以上經驗者。 ●具下列任一條件者佳: (1) 具有音訊處理相關演算法經驗或濃厚興趣者 (2) 熟悉錄音工程與播放工程者 (3) 熟音訊編解碼理論者 (4) 熟語音訊號處理者 (5) 熟語音降噪、AEC、麥克風陣列者 (6) 熟 DSP 與音訊處理者 (7) 熟語音辨識演算法者 ●工作項目： 開發創新的音訊或語音演算法。

工作項目： 1. FinFET製程記憶體設計開發。 2. 客製化記憶體設計開發。 3. 支援記憶體智財量產性能,良率提升。 應徵條件： 1. 碩士以上; 電機工程、電子工程相關科系畢業為主。 2. 熟悉 Hspice, Spectre, XA, Solido等 simulation tool, Virtuso, Laker等 layout tool. 3. 具3年以上下列經驗之一者為佳 (1) 熟知 CMOS元件與 SRAM/其他記憶元件特性。 (2) 熟稔並執行過 SRAM/CAM電路開發工作。 (3) 具 FinFET電路設計與佈局設計經驗。

工作項目： 1. 負責封裝 SI/PI模擬，並協助優化封裝設計。 2. 負責封裝前期規劃,找出前瞻性封裝設計。 3. 負責 SI/PI Debug與量測等相關實驗。 應徵條件： 1. 碩士以上; 電機工程、電信工程、電控工程、電子工程、動力機械、自動控制、通訊工程等相關科系畢業為主。 2. 具 FCBGA/wBGA/QFN/QFP等相關封裝SIPI設計經驗。 3. 熟悉封裝 EM Simulation方法。

應徵條件： 1. 碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2. 熟悉 Verilog RTL Design、SoC Integration & Design Flow、Frontend EDA Tools、Synthesis & STA Methodology、Low Power Design & Verification。 3. 具備 IP Integration、Hierarchical Implementation、Verification 能力；熟悉 TCL/Perl/C++/Python。 4. 英文能力良好，聽說讀寫精通。 5. 有 CPU、GPU、Multi-Core Processor Development 經驗尤佳，例如 Design/Integration/Synthesis/DFT/Timing Closure/Sign-off/Production 等。 6. 積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。 工作項目： 1. High-Performance CPU & GPU Frontend Implementation 2. Advanced CPU Technology Development: High-performance, Ultra-low Power, and PPA Optimization 3. Processor Frontend Development Flow Enhancement & Automation 應徵條件： 1. 碩士以上；電機、電機與控制、資訊工程、電子相關科系畢業為主。 2. 熟悉 Verilog RTL Design、SoC Integration & Design Flow、Frontend EDA Tools、Synthesis & STA Methodology、Low Power Design & Verification。 3. 具備 IP Integration、Hierarchical Implementation、Verification 能力；熟悉 TCL/Perl/C++/Python。 4. 英文能力良好，聽說讀寫精通。 5. 有 CPU、GPU、Multi-Core Processor Development 經驗尤佳，例如 Design/Integration/Synthesis/DFT/Timing Closure/Sign-off/Production 等。 6. 積極負責、勇於迎接挑戰，對於 High-Performance CPU/GPU、Advanced PPA Optimization、Energy Efficiency Technology 有興趣者。

工作項目： 1. CPU & GPU Backend Implementation (APR) 2. CPU/GPU Backend Flow Development, Enhancement & Automation 3. Advanced CPU/GPU Technology Development: High-performance, Low Power, and PPA Optimization 應徵條件： 1. 碩士以上；電機、資工、電子相關科系畢業為主。 2. 熟悉 APR Tools (Innovus、ICC2、Fusion Compiler…)，有Synthesis、STA/IR Analysis、Physical Verification等相關經驗者佳。 3. 具備程式設計能力，熟悉 TCL/Perl/C++/Python。 4. 有 High Performance CPU/GPU APR經驗尤佳。 5. 個性積極負責、勇於迎接新挑戰，對於 High-Performance CPU/GPU Technology 有興趣者。

工作項目： 1. High-Performance CPU/GPU Timing & Power Integrity Signoff 2. High-Performance CPU/GPU Post-Silicon Validation & Debug, Sim-to-Silicon Correlation 3. 協同開發 CPU/GPU Advanced DFT, On-Chip PVT Sensor, Performance Improvement & Power Management 等先進技術 4. 支援產品 SoC Projects，協同執行 High-Performance CPU/GPU 專案開發，導入先進 IP 及技術 應徵條件： 1. 碩士以上；電機、資工、電子相關科系畢業為主。 2. 熟悉 SoC Integration & Design Flow、Frontend/Backend/DFT/Timing/IR Drop/Power Analysis EDA Tools。 3. 有 ARM Cortex-A CPU/Subsystem Design/Integration/PPA Optimization/Sign-off 經驗尤佳。 4. 有 Chip-Level, Package & PCB Power Integrity Optimization 經驗尤佳。 5. 有On-Chip PVT Sensor 開發經驗尤佳。 6. 有Post-Silicon Validation, Debug 及 RMA 分析經驗尤佳。 7. 積極負責、溝通協調能力強、勇於迎接挑戰，對於 High-Performance CPU/GPU Technology 有興趣者。

工作項目： 1. ARM Architecture based Complex CPU Subsystem Platform Design & Integration, Add-on Features Enablement and IP Development 2. SoC Architecture Exploration, Performance Projection and Bottleneck Analysis 3. Benchmark/Power Characterization on Emulation Platform, Result Analysis and Optimization 4. CPU Architecture/Micro-architecture Research 5. Involvement of Post-silicon Bring-up and Debug 應徵條件： 1.碩士以上；電機、資工、電子相關科系畢業為主。 2.具IP開發經驗，熟悉 SoC Integration & Design Flow、Frontend Timing/Power Analysis EDA Tools。 3.熟悉ARMv7/v8-A CPU 架構及AMBA protocol，有 ARM Cortex-A CPU/Subsystem Design/Integration/PPA Optimization/Sign-off 經驗尤佳。 4.具Emulation platform (Zebu, Palladium)經驗尤佳。 5.有 Low Power Design & Verification、Post-Silicon Validation & Debug 經驗尤佳。 6.積極負責、溝通協調能力強、勇於迎接挑戰，對於 High-Performance CPU Technology 有興趣者。

工作項目： 1. CPU & GPU Backend Implementation (APR) 2. CPU/GPU Backend Flow Development, Enhancement & Automation 3. Advanced CPU/GPU Technology Development: High-performance, Low Power, and PPA Optimization 應徵條件： 1. 碩士以上；電機、資工、電子相關科系畢業為主。 2. 熟悉 APR Tools (Innovus、ICC2、Fusion Compiler…)，有Synthesis、STA/IR Analysis、Physical Verification等相關經驗者佳。 3. 具備程式設計能力，熟悉 TCL/Perl/C++/Python。 4. 有 High Performance CPU/GPU APR經驗尤佳。 5. 個性積極負責、勇於迎接新挑戰，對於 High-Performance CPU/GPU Technology 有興趣者。

工作項目： 1. Software and utility development for ARM Architecture based Complex CPU Subsystem Platform 2. CPU function validation and testing software development 3. CPU post-silicon issue analysis, debug & resolving 應徵條件： 1. 碩士以上; 資訊工程、資訊科學、電機工程、電子工程等相關科系畢業。 2. 熟悉 ARMv7/v8/v9-A CPU 架構，有 ARM Cortex-A CPU system software 經驗尤佳。 3. 熟悉以下經驗者： (a) CPU 之系統程式或工具開發。 (b) CPU/OS之 debug 及問題分析。 (c) CPU post-silicon issue analysis, debug & resolving。 (d) 具備 Verilog RTL 及相關工具軟體開發經驗。 4. 積極負責、溝通協調能力強、勇於迎接挑戰，對於 High-Performance CPU Technology 有興趣者。

1.客戶拜訪開發並推銷產品 2.依顧客需求做報價及簽約 3.顧客意見回饋以供公司改善參考 4.定期與主管做業績、績效檢討，回報進度