交大專區

1. 熟悉內部稽核、內部控制、風險管理或資訊系統稽核基本方法，能將流程風險轉化為可測試的控制點與稽核程序。 2. 具備 IC 設計、半導體、電子產品研發或軟硬體開發流程之基本理解，了解從需求、設計、驗證、release 到量產維護之流程風險。 3. 熟悉研發流程常見控制，例如 design review、code review、branch protection、bug tracking、coverage review、waiver approval、release gate、tape-out sign-off 等。 4. 具備資料分析能力，能使用 SQL、Python、Excel Power Query、Power BI、Tableau 或其他資料分析工具進行資料清理、比對、例外偵測與視覺化。 5. 能理解並分析研發系統資料，例如 Git / GitLab / GitHub、Jira、bug tracking system、PLM、release system、IAM、HRIS、EDA / CAD flow log 或其他工程資料。 6. 具備權限管理與存取控制概念，理解 least privilege、JML access control、privileged account review、terminated user access removal、role-based access control 等控制。 7. 了解資訊安全與資料保護基本概念，包括 DLP、USB / cloud storage control、source code protection、sensitive data classification、audit trail、log review 等。 8. 了解智慧財產權與研發資料保護風險，例如 High Sensitive IP、third-party IP、open source software、SBOM、EDA / PDK / Foundry data、NDA data、export control 等。 9. 具備流程訪談與跨部門溝通能力，能與 RD、IT、資安、資料治理、法務、專案管理及流程 Owner 討論風險、控制、資料來源與改善方案。 10. 具備將業務問題轉換為資料規則的能力，例如將「未完成 code review 即 release」轉換為 commit、PR、approval、release tag 之間的資料比對邏輯。 11. 對 AI、Agent、RPA 或自動化稽核工具有興趣或實務經驗，能協助規劃 Audit Agent 的測試規則、資料需求、輸出格式與人工覆核流程。 12. 具備良好文件撰寫能力，能撰寫稽核底稿、流程圖、風險控制矩陣、缺失描述、根本原因分析、改善建議與管理階層報告。 13. 具備獨立思考、問題分析與專案管理能力，能同時處理多項稽核任務、資料分析需求、缺失追蹤與跨單位溝通。 14. 具備高度職業道德、保密意識與風險敏感度，能審慎處理研發機密、客戶資料、IP 資料、權限資料與稽核發現。

影像編解碼器硬體架構設計與電路實現

負責MCU/MPU(Microprocessor Unit)平台之嵌入式軟韌體開發、驗證與維護 1.設計、開發和優化 MCU/MPU 的軟體，包括初始化/啟動程式碼、驅動程式和外設庫 2.與硬體工程師、系統工程師協作，完成軟硬體整合與驗證 3.分析並解決MCU/MPU應用開發過程中的技術問題

1. High Speed digital design implementation 2. Integration from RTL to gate level, including flow QC, timing closure and issue analysis & solving 3. Signoff on design with mixed-signal interface 4. Design methodology and integration flow improvement

Co-work with algorithm, digital/analog design, firmware, AI tool teams. 0+ ~ 10+ Years Experience in: Agentic AI Workflow/Tool Evaluation/Deployment Data Center & High-Speed SerDes Design Verification Plan & Project Execution Automotive Design Verification Plan & Project Execution 5G/6G Wireless Communication Design Verification Plan & Project Execution Satellite/NTN Communication Design Verification Plan & Project Execution Processor Platform/Peripherals Design Verification Plan & Project Execution Subsystem / System Level Design Verification Plan & Project Execution

1. 2.5D/3.5D package technology development​ 2. SoC/Memory heterogeneous integration package development​ 3. Package technology integration, NPI and MP​ 4. Project management​

根據不同專案使用的各種CPU架構: * Function validation * Margin characterization & validation * System stability validation * Power/VF/Benchmark characterization * Customer issue resolve

* 根據積體電路設計流程、半導體器件、良率提升等相關知識進行數據分析 * 建立人工智慧框架與工作流程，以提升數據運營與分析的生產力 * 與不同的內部及外部團隊溝通協作，提出策略建議

IC設計: 晶片整合 IP開發

1. 規劃NPU量產測試程式 2. 測試及驗證IC功能、性能以及功耗的分析改進 3. 分析測試資料及測試相關問題，並分析良率問題並改善 4. AVS low power 的設計

SOC Pre-Silicon 平台技術, 流程方法, 參考設計開發

1. 參與CPU IP電路設計弱點之檢視與審查。 2. 開發 CPU IP 電路穩定度之測試項目，以排查/篩選出電路弱點。 3. 制定 CPU 電源完整性與電源量產品質方法

負責設計並優化數位相機及影像信號處理領域之IC，與演算法團隊協作，共同開發領先業界的影像處理解決方案，應用於智慧型手機、平板、車用及家庭娛樂等高成長市場。 工作職責 : - 與演算法工程師協作，設計高效能影像信號處理（ISP）/電腦視覺（CV）電路 - 提供優化硬體方案，達成IC設計「黃金三角」：最小矽面積、極低功耗、最佳影像品質 - 負責RTL設計、模擬、驗證、邏輯合成與整合流程 - 參與專案系統架構與技術研討，提出創新設計方案 - 支援產品跨部門整合及技術溝通

需求分析、架構設計 - 分析來自客戶的需求 - 了解客戶的期待 - 同意或拒絕客戶需求 - 依據需求提出架構設計

1. 系統軟體平台開發與建置 2. OS / multiple-thread相關實作 3. 平台驗證與AI流程導入設計 4. 硬體平台與實驗設備協助 5. 跨國溝通之技術文件整理

1. Work on 2~4nm design implementation, methodology, and sign-off 2. Perform synthesis, DFT, floorplan, clock planning, place and route, timing closure, ECO, IR signoff, and physical verification 3. Manage schedule, resolve design and flow issues, drive methodologies and execution

1. 使用模擬工具分析汽車SoC的性能、功耗和熱管理指標。 2. 改進模擬模型，識別並針對SoC最佳化領域。 3. 實施策略，提升車載SoC的性能和效率。 4. 自動化評估流程，實現持續的SoC最佳化。 5. 跟進汽車SoC設計的最新進展，專注於系統層面的改進。

The candidate will design, supervise layout, help characterize transceiver front-end circuits for WiFi and Bluetooth production.

1. FR1/FR2/FR3射頻收發機設計 2. 低雜訊放大器, 混頻器, 訊號源產生器, 放大器鏈, 功率放大器設計 3. 低功耗射頻電路設計 4. 射頻設計方法及整合流程優化

1. 無線 RFIC 類比電路設計. 2. 頻率合成器, 鎖相迴路, 壓控振盪器, 晶體振盪器, 除頻器 設計.